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AD9643有的是種雙14位齒條參數變為器（ADC），取樣效率更是高達250毫秒/秒。AD9643是為認可網絡通信用途而開發的，以上用途需求低利潤、小規格、聯通帶寬寬和多用途性。雙ADC內在含有層級、差過渡水線形式和一體化型的內容輸入打出糾正錯誤方式。任何ADC含有聯通帶寬寬輸進，認可幾種玩家可以選擇擇的輸進領域。一體化型電壓降系數簡單化了開發采取。占空比穩固器主要用于拆遷補償ADC秒表占空比的變動，使變為器要保持達標率的安全性能。ADC內容輸入打出數值之間路由到這兩個對外部14位LVDS內容輸入打出端口處，并制式變為混合或傳輸復接。靈活多變的24v主機電源關閉程序首選項限制在需求時相關系數節約使用24v主機電源。

共同點在185 MHz AIN和250 MSPS時，信噪比=70.6 dBFS在185 MHz AIN和250 MSPS時，SFDR=85 dBc-151.6 dBFS/Hz錄入噪音，185 MHz，?1 dBFS AIN和250毫秒總顯卡功耗：785萬千瓦，250萬千瓦/秒1.8 V電交流電壓LVDS（ANSI-64四級）輸出整數1到8復制粘貼鬧鐘分頻器（625 MHz較大 復制粘貼）取樣率達到了250 MSPS中頻采集聲音頻率可以達到400兆赫組織結構ADC規范電壓降靈便的仿真模擬設置的范圍1.4 V p-p至2.0 V p-p（標稱1.75 V p-p）ADC石英鐘占空比不穩器95 dB端口防護/串擾串口把控節約停電摸式朋友可顯卡配置，內嵌式檢測試（BIST）功用

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