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DS878是一款高速直接數字頻率合成器(DDS)，頻率調諧分辨率為32位，ROM相位分辨率為13位，DAC幅度分辨率為11位。DAC模擬輸出可在正常保持模式（用于第一奈奎斯特頻段）和回零模式（用于第一，第二和第三奈奎斯特頻段）操作之間選擇。DS878和DAC正常保持模式下，可在第一奈奎斯特頻段附近產生最高1.8 GHz的頻率（時鐘速率為3.6 GHz），或在DAC調零模式下產生最高5.4 GHz的第三奈奎斯特頻段。

DS878初始相位可以復位到零度啟動。該芯片有一對互補的模擬輸出，后端為50-∧。輸出波形的頻率可由32個頻率控制位VI[0:31]控制。DS878可接受差分時鐘輸入或單端時鐘輸入，具有50-∧片內后端端子和用戶自定義閾值。頻率分辨率位接受LVTTL或CMOS輸入電平。差分同步輸入SYNCI_P/N為多個芯片應用提供同步，啟動每個芯片準備接受頻率字輸入。

DS878內部產生的同步選通輸入除以8時鐘躍遷沿鎖存器，這些時鐘也發送到SYNCO_P/N。輸出引腳SYNCO_P/N作為參考，頻率字和頻閃輸入時序與內部同步，以8個時鐘分頻，從而正確鎖定。復位是異步的，以最大限度地降低模擬輸出有效性的時鐘延遲。

DS878主要特征

32位的頻率調諧字

13位ROM相位電話號碼辨析

電影里中的11位dac

鐘表工作頻率獨角獸高達4.5GHz

模擬仿真導出不錯在正常的穩定文件后綴和零文件后綴當中通過首選

正弦交流電波制造的首位個奈奎斯特帶更是高達2.25GHz，第3個奈奎斯特頻譜占據正常情況下維持形式或6.75GHz零化模式英文。

在4 GHz掛鐘頻率下，最爛的聯通寬帶SFDR貼近50 dBc(dc到2 ghz傳輸速率)

50后面相輔相成模擬訓練弧形輸出的

多片一起P/N導入

SyncO_P/N為資料加載失敗和一起選通訊網絡號供應了參考資料。

LVTTL/CMOS阿拉伯數字傳統模式把控復制粘貼

異步歸位(RST)引腳疏導0關鍵時期(IQSL=低)或90(IQSL=高)啟動服務器睡眠狀態

適用更行率Word和DAC所在頻帶寬度的Strobe復制粘貼(STRBUP/N)

寬的數據統計加載失敗觀察窗口不能DS 878由存儲空間器和微保持器保持，FPGA或DSP集成電路芯片在秒表頻次換算步驟中不需要脫鏈或故章就都可以不斷更新多8個掛鐘過渡期的頻點字。

單-5V供電的工作頻率為4.3W

64針QFN9x9二極管封裝

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